1樓：劉勇傑
之前看過cadence virtusol XLG的demo演示（憑記憶，不敢說一定沒記錯），雖然不能說非常接近，但是感覺已經很有customer layout自動化的感覺了，特別是在布線上，和某些器件級別的組合圖形生成上，工具可以做的已經很多了；感覺工具的瓶頸是模組級別的floorplan上，，那麼布局也有可能也能得到優化。
首先，從virtusol XL開始就已經是SDL flow了，device都不用自己乙個乙個去call到layout裡頭。對特定的器件組合，比如一組transistor matching,你可以用預設的或者自己定義的pattern，直接從layout裡頭call出來乙個command central的matching 結構，如果需要的話還可以包含這個部分的連線。
其次，對於器件之間的佈線，工具也可以根據你的需求來定製，減少很多layout engineer的工作，比如你對一組線做equal length，工具可以根據你滑鼠的移動實時計算連線的圖形並且可以幫你避開已經存才的圖形。對於一些特定地方的佈線，也可以寫一些指令碼根據label來自動routing，並設定金屬的層次。
最後，個人感覺無論是數字還是模擬，自動化是不可避免的。
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