1樓：
能抓到CPU到記憶體之間的資料介面通訊的話，是可以通過介面通訊一定程度上重建cache內容的。
ARM的有些核支援cache debug。但是應該需要debugger介入。
2樓：qin meng
設計上和理論上應該是透明的，但是並非完全不能控制，不少處理器還是有cache的預取和清除等指令的，程式設計加入可以更有效利用cache，當然用不好也會更劣化。
實際當中呢，並不完全透明。能不能讀取cache內容呢？能，但是方法比較特殊，僅限於現在有meltdown bug的處理器上，這個bug的方式就是靠一些邪門歪道的方式取cache裡面的東西，然後讀取寫不該讀取到的東西。
但這些都是意外，理論上不應該出現這種情況。
3樓：zr scat
對使用者態程式是透明的。
對於核心態程式，特別是某些驅動，硬體傳輸資料到記憶體之後，cpu其實是並不知情的，此時如果cache沒有重新整理，會出現資料不一致。
通常可以在讀取資料之前invalid cache，或者簡單粗暴的對某記憶體區域禁止cache來解決此問題。
4樓：張驍
半透明吧，說他透明是因為軟體真的不好精確控制快取的寫入時機，說他半透明是因為軟體還是有機會參與控制讀寫策略，有能力精準的清快取。這塊，可以看看頁表操作，找個DMA對映函式跟進去看一下。
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